由或非门和与非门分别构成RS触发器,输入信号分别是低电平有效还是高电平有效?
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同步RS触发器为了引入CP时钟信号在基本RS触发器的基础上增加了两个与非门,分别将R、S端的输入信号与CP信号进行了与非运算后再传给基本RS触发器R‘和S’端,当CP为1时,R‘=(CP▪R)’=R的反,S‘=(CP▪S)’=S的反,所以基本RS触发器是低电平有效而同步RS触发器是高电平有效2个与非门构成的RS触发器,原理是输出0、输出1、输出保持不变。
2个或非构成的RS触发器,原理和与非门是类似的,当R为0、S为1时,Q为1、Q非为0;当R为1、S为0时,Q为0、Q非为1,当R与S都为1,时,则Q和Q非都为0,当R和S都为0时,则会出现输出状太混乱的局面,这个理论上和RS与非门触发器差不多,RS输出都不能同为0。用与非门构成的基本RS触发器,应当遵守S*R=0的约束条件,但不能加以R'=S'=0的输入信号,对于用或非门构成的基本RS触发器,应当遵守S*R=0的约束条件,但不能加以R=S=1的输入信号。 如果Q端的初始状态设为1,RD、SD端都作用于高电平(逻辑1),则y一定为0。如果RD、SD状态不变,则Q及y的状态也不会改变。这是一个稳定状态。 同理,若触发器的初始状态Q为0而y为1,在RD、SD为1的情况下这种状态也不会改变。这又是一个稳定状态。它具有两个稳定状态。 输入与输出之间的逻辑关系可以用真值表、状态转换真值表及特征方程来描述。 真值表: R-S触发器的逻辑功能,可以用输入、输。
2个或非构成的RS触发器,原理和与非门是类似的,当R为0、S为1时,Q为1、Q非为0;当R为1、S为0时,Q为0、Q非为1,当R与S都为1,时,则Q和Q非都为0,当R和S都为0时,则会出现输出状太混乱的局面,这个理论上和RS与非门触发器差不多,RS输出都不能同为0。用与非门构成的基本RS触发器,应当遵守S*R=0的约束条件,但不能加以R'=S'=0的输入信号,对于用或非门构成的基本RS触发器,应当遵守S*R=0的约束条件,但不能加以R=S=1的输入信号。 如果Q端的初始状态设为1,RD、SD端都作用于高电平(逻辑1),则y一定为0。如果RD、SD状态不变,则Q及y的状态也不会改变。这是一个稳定状态。 同理,若触发器的初始状态Q为0而y为1,在RD、SD为1的情况下这种状态也不会改变。这又是一个稳定状态。它具有两个稳定状态。 输入与输出之间的逻辑关系可以用真值表、状态转换真值表及特征方程来描述。 真值表: R-S触发器的逻辑功能,可以用输入、输。
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