数字电路专业知识求解答``各位帮帮忙啊`` 40
某个董事局进行表决,共有6名董事(分别设为A1,A2,A3,A4,A5、A6)一名秘书长(设为b),一名董事长(设为c),表决程序为所有董事投票,按少数服从多数原则表决,...
某个董事局进行表决,共有6名董事(分别设为A1,A2,A3,A4,A5、A6)一名秘书长(设为b),一名董事长(设为c),表决程序为所有董事投票,按少数服从多数原则表决,秘书长与董事长不参与投票,若反对与赞同人数对等,则秘书长投票,结果呈送董事长,最终董事长具有一票否决权(没有一票通过权)。各位与会人员同意为真,用1表示,不同意为假,用0表示。请用电路仿真软件设计该董事局表决器。(可以用异或和同或门实现)请求电路图 。
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解决逻辑问题是问题的关键。解决步骤如下:
1. 用表列出A1-A6表决的所有可能情况(2的6种结果),即表决第一阶段的真值表,这又分为两类,A:设赞同数为x,反对数为y,x>y或x<y,直接出表决结果,B: x=y,则秘书长投票,又分为两种结果,秘书长弃权与否,秘书长弃权,则交由董事长否决。
2. 将A1-A6的所有表决组合化为最小项,用格雷码画出六变量卡诺图,求出组合逻辑函数,化为用异或和同或门的表达式。
3. 在2的输出端加上秘书长表决电路
4. 在3的输出端加上直接置0电路
5. 便VHDL程序(可以用原理图实现)
1. 用表列出A1-A6表决的所有可能情况(2的6种结果),即表决第一阶段的真值表,这又分为两类,A:设赞同数为x,反对数为y,x>y或x<y,直接出表决结果,B: x=y,则秘书长投票,又分为两种结果,秘书长弃权与否,秘书长弃权,则交由董事长否决。
2. 将A1-A6的所有表决组合化为最小项,用格雷码画出六变量卡诺图,求出组合逻辑函数,化为用异或和同或门的表达式。
3. 在2的输出端加上秘书长表决电路
4. 在3的输出端加上直接置0电路
5. 便VHDL程序(可以用原理图实现)
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列真值表,然后写出表达式,利用卡诺图来化简,最后根据结果画出相应的电路图。
如果利用仿真软件的话,可以根据你的化简结果利用EDA工具来实现该电路图。
如果是作业的话你最好自己做的,我看这么简单应该是作业的吧,呵呵呵。
如果利用仿真软件的话,可以根据你的化简结果利用EDA工具来实现该电路图。
如果是作业的话你最好自己做的,我看这么简单应该是作业的吧,呵呵呵。
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同意一楼回答,牛!卡诺图和EDA.
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