cadence 修改原理图后重新生成网表,导入后出现状况,求高人指点
cadence中更改原理图后,再次生成网表后,导入到之前的PCB板子中,但是就有那么几个器件和一个网络标号上的所有连线和焊盘,显示成这种感觉被选中的样子,求解答?...
cadence 中 更改原理图后,再次生成网表后,导入到之前的PCB板子中,但是就 有那么几个器件和一个网络标号上的所有连线和焊盘,显示成这种感觉被选中的样子,求解答?
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