“&”在“VHDL”语言中是什么意思？具体怎么用？
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并值符号：如果clk1上升沿到了，datacom的类型应该是std_logic_vector,假设是2位的。那么就是std_logic_vector（1 downto 0）。fskcodein应该是bit类型，那么就是把fskcodein的数值和datacom的高位组成一个新的2位的datacom。
假如datacom：out std_logic_vector（1 downto 0）
datacom<="01" 高位是0
fskcodein: out bit;
fskcodein<='0' 是0
那么新的datacom是00
假如datacom：out std_logic_vector（1 downto 0）
datacom<="01" 高位是0
fskcodein: out bit;
fskcodein<='0' 是0
那么新的datacom是00
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