单片机引脚的低电平高于1V,甚至快到2V了,怎么调低呢?
我用的89S52单片机,这个电平可以用软件来调低吗?我按照你们的方法做了,加了下拉电阻,但是低电平没有变化,高电平却下降了不少,这个怎么回事呢?因为硬件都是老板设计的,电...
我用的89S52单片机,这个电平可以用软件来调低吗?
我按照你们的方法做了,加了下拉电阻,但是低电平没有变化,高电平却下降了不少,这个怎么回事呢?
因为硬件都是老板设计的,电路图我这里没有,只有一块板子,主要是从P3^4引脚输出1K的频率给电机,但是电机转动的时候噪声很大,在示波器上观察了波形,发现低电平电压比较高,所以觉得问题在这里。
再问下啊
用单片机输出频率驱动电机一定需要光电耦合吗? 展开
我按照你们的方法做了,加了下拉电阻,但是低电平没有变化,高电平却下降了不少,这个怎么回事呢?
因为硬件都是老板设计的,电路图我这里没有,只有一块板子,主要是从P3^4引脚输出1K的频率给电机,但是电机转动的时候噪声很大,在示波器上观察了波形,发现低电平电压比较高,所以觉得问题在这里。
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推荐于2018-04-12 · 知道合伙人教育行家
hi漫海feabd5e
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本科学历,毕业后从事设计工作;现任标码石材科技有限公司设计员。能决绝结构设计方面中等难度问题。
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单片机引脚的低电平高可以接下拉电阻,作用是与上接电阻一起在电路驱动器关闭时给线路(节点)以一个固定的电平。下拉电阻的设定的原则和上拉电阻是一样的。
下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定,主要需要考虑以下几个因素:
1. 驱动能力与功耗的平衡。以上拉电阻为例,一般地说,上拉电阻越小,驱动能力越强,但功耗越大,设计时应注意两者之间的均衡。
2. 下级电路的驱动需求。同样以上拉电阻为例,当输出高电平时,开关管断开,上拉电阻应适当选择以能够向下级电路提供足够的电流。
3. 高低电平的设定。不同电路的高低电平的门槛电平会有不同,电阻应适当设定以确保能输出正确的电平。以上拉电阻为例,当输出低电平时,开关管导通,上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。
4. 频率特性。以上拉电阻为例,上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟,电阻越大,延迟越大。上拉电阻的设定应考虑电路在这方面的需求。
OC门输出高电平时是一个高阻态,其上拉电流要由上拉电阻来提供,设输入端每端口不大于100uA,设输出口驱动电流约500uA,标准工作电压是5V,输入口的高低电平门限为0.8V(低于此值为低电平);2V(高电平门限值)。
下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定,主要需要考虑以下几个因素:
1. 驱动能力与功耗的平衡。以上拉电阻为例,一般地说,上拉电阻越小,驱动能力越强,但功耗越大,设计时应注意两者之间的均衡。
2. 下级电路的驱动需求。同样以上拉电阻为例,当输出高电平时,开关管断开,上拉电阻应适当选择以能够向下级电路提供足够的电流。
3. 高低电平的设定。不同电路的高低电平的门槛电平会有不同,电阻应适当设定以确保能输出正确的电平。以上拉电阻为例,当输出低电平时,开关管导通,上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。
4. 频率特性。以上拉电阻为例,上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟,电阻越大,延迟越大。上拉电阻的设定应考虑电路在这方面的需求。
OC门输出高电平时是一个高阻态,其上拉电流要由上拉电阻来提供,设输入端每端口不大于100uA,设输出口驱动电流约500uA,标准工作电压是5V,输入口的高低电平门限为0.8V(低于此值为低电平);2V(高电平门限值)。
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估计是被你的外围电路把电压给抬高了,加一个下拉电阻试试
或者加个隔离电路,将后面的电路隔离,避免后面电路影响前端
补充回答;
加下拉,高电平下来了,电路中应该有上拉,这样就形成了分压,所以将高电平拉下来了
你最好用光耦做隔离,因为电机转动时耗电流挺大,所以单片机管脚输出电流驱动不够,所以用光耦顺便增加驱动
或者加个隔离电路,将后面的电路隔离,避免后面电路影响前端
补充回答;
加下拉,高电平下来了,电路中应该有上拉,这样就形成了分压,所以将高电平拉下来了
你最好用光耦做隔离,因为电机转动时耗电流挺大,所以单片机管脚输出电流驱动不够,所以用光耦顺便增加驱动
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那个IO口并联一个电阻 电阻另一头接地………………传说中的下拉电阻!
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不是软件的问题,是外围电路把引脚拉高了,估计你外面应该接了一个上拉之类的电路,像楼上所说的,IO口接一个下拉电阻,电阻另一端接地,应该可以搞定。
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外电路把低电平抬高了,用光耦或其它隔离方式驱动比较好。
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