verilog中inout的使用
inoutdata_inout;inputdata_in;regdata_reg;//data_inout的映象寄存器reglink_data;assigndata_in...
inout data_inout;
input data_in;
reg data_reg; //data_inout的映象寄存器 reg link_data;
assign data_inout=link_data?data_reg:1’bz; //link_data控制三态门
网上基本上都是这种写法，但是不太理解，data_in根本就没有用到啊，它是怎么工作的 展开
input data_in;
reg data_reg; //data_inout的映象寄存器 reg link_data;
assign data_inout=link_data?data_reg:1’bz; //link_data控制三态门
网上基本上都是这种写法，但是不太理解，data_in根本就没有用到啊，它是怎么工作的 展开
1个回答
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一般都会在两边 配上读写使能的 来判定数据的流向
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追问
你就给我说说上面那个写法吧，我不太会用，data_in与data_out该怎么连接进来，网上还说data_in要为寄存器型，data_out要为wire型
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