基于Quartus2设计模100计数器，用两个数码管显示
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发个同步使能及异步清零的吧
10进制的如下：（此为底层模块，100计数器调用此模块）
module count10(qout,q,clk,clken,clr);
input clk,clken,clr;
output qout;
output[3:0]q;
reg[3:0] q;
reg qout;
always @(posedge clk or posedge clr)
begin
if(clr)
begin
q<=4'd0;
qout<=0;
end
else if(clken)
if (q[3]&q[0])
begin
q<=4'd0;
qout<=1;
end
else
begin
q<=q+1;
qout<=0;
end
else
q<=q;
end
endmodule
100计数器模块如下：（顶层模块）
module count100(qout,q1,q2,clr,clken,clk);
input clr,clken,clk;
output[3:0] q1,q2;
output qout;
wire qout1;
count10 c1(qout1,q1,clk,clken,clr);
count10 c2(qout,q2,qout1,clken,clr);
endmodule
这是以前做的工程中的10000计数器改写的。你试试吧！！
10进制的如下：（此为底层模块，100计数器调用此模块）
module count10(qout,q,clk,clken,clr);
input clk,clken,clr;
output qout;
output[3:0]q;
reg[3:0] q;
reg qout;
always @(posedge clk or posedge clr)
begin
if(clr)
begin
q<=4'd0;
qout<=0;
end
else if(clken)
if (q[3]&q[0])
begin
q<=4'd0;
qout<=1;
end
else
begin
q<=q+1;
qout<=0;
end
else
q<=q;
end
endmodule
100计数器模块如下：（顶层模块）
module count100(qout,q1,q2,clr,clken,clk);
input clr,clken,clk;
output[3:0] q1,q2;
output qout;
wire qout1;
count10 c1(qout1,q1,clk,clken,clr);
count10 c2(qout,q2,qout1,clken,clr);
endmodule
这是以前做的工程中的10000计数器改写的。你试试吧！！
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哈美顿（上海）实验器材有限公司
2024-11-20 广告
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