max plus如何将verilog转化为电路图,在线等！多谢大侠！
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你编译过代码后，找到RTL级示意图的选项。你可以看到寄存器传输级的逻辑图。电路图的话，应该不太可能。最多通过plac&route后生成网表。
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赛恩科仪
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