ORCAD画原理图哪些属于非法字符?

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zhangqiyan89
2013-11-05
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对于Orcad9.2:

1.Orcad9.2中把“#”、“$”、“<”、“>”定义为非法字符,Net、Pin、Part的命名不能含有这些非法字符;

2.Value值不允许含有“,”;
3.Reference中不能含有空格,而且应该是字母与数字的组合,不能只含字母;

关于EMC的原理设计:
1.在时钟的输入和输出端预留RC位置,不同的时钟频率需要匹配不同的RC网络;
2. 器件选择上,不宜采用IC
座:IC座对EMC 很不利,建议直接在PCB上焊接表贴芯片,具有较短引线和体积较小的IC芯片则更好,
BGA及类似芯片封装的IC在目前是最好的选择。安装在座(更糟的是,插座本身有电池)上的可编程只读存储器(PROM)的发射及敏感特性经常会使一个本
来良好的设计变坏。因此,应该采用直接焊接到电路板上的表贴可编程储存器。
画原理图时需要注意的:

1.每个器件的value值应该清晰、明了地注明,如76功放板中的1206磁珠的value值只写TB321611U520,没有把80欧的值明确的标出来;而且value值应该简短,避免做元件图时value值显示太长,超出器件的范围;

2.在原理图中,所有的Part都需要和Allegro库中的Symbol一致,比如管脚个数、管脚命名、管脚次序等等。例如定位孔的Part要规范,有些设计中是用8Pin的有些是用9Pin的,故制作Part时,请先查看Allegro相应的库;

3.原理图中表示不焊的器件:value的模式请按如下方式编写:opt(value),在Allegro中显示value值时,会滤去(value),只保留opt,表示不焊的器件。

4.Reference
命名规范(“?”表示个数的排序):普通表贴电容用C?,电解电容用CE?,钽电容用CT?,排容用CN?,普通表贴电阻用R?,排阻用RN?,磁珠用
FB?,表贴和直插电感用L?,保险丝用PS?,二极管三极管用D?,普通插针用J?,跳线用的插针用JP?,风扇插座用JFAN?,串口用COM?,并
口用PRT?,芯片用U?,并口用PRT?,USB接口用USB?,带护边的插座用CON?,电源插座用PW?,鼠标用MS?,键盘用KB?,网口用
RJ45_?,视频口用VGA?,串口扩展口用DB26_?,PCI用PCI?,IDE插座用IDE?,内存插槽用DIMM?,电池插座用BAT?,定位
孔用MH?,晶振钟振用X?。

备注:有些接口如果采用插针引线方式,还是按照接口的属性来命名,比如前置USB1采用2×5的插针,该插针就应该用USB1的Reference。

5.value值统一:0.001uF(1000pF)、0.01uF(10000pF)、0.1uF、1uF电容一律用102、103、104、105来命名,

6.如果元件的Part分为几部分,则要求这几部分的Source Part和Source
Package一致,不然重排Reference时会把该元件按Part分为几个元件。

7.编辑已有的元件时,如果该元件的Part分为几部分,则应该在总的Part下进行编辑,几个部分都编辑完后再Update整个Part。

8.对于内存部分:匹配的排阻以及上拉排阻,它们中各个电阻所用在的Net,请根据已有的板进行设计,不希望出现到PCB阶段才发现排阻中有些与DIMM的上部相连,有些与DIMM的下部相连,这样走线非常困难。

9.在每一页的sch中,不要画太多的线路,因为,如果需要打印出来,线路图会非常小,难于查看、辨认。

备注:以下是一些额外的信息,不在我们现在制作原理图的规范要求中。
对于Capture10.3:
1.每个Pin
Number都要有,就连电阻两端的Pin Number都要设置;
2.如果Pin的类型是Passive,每个Pin
name都需要不同,就连GND都要设成不一样的Pin name,比如设成GND1和GND2;如果Pin的类型是Power,则VCC和GND的Pin
name可以一样;

3.在每个Part的Property中,要么不需要Device的属性,要么就是Device的值要与每个相同Part的值不一样,相同的话会出现以下错误提示:

Error [ALG0011] Conflicting values of Source Part names found on
MH8(MOUNTING HOLE_2) and MH6(MOUNTING HOLE_1) for part "DRILL160NC_PAD300-PL".

4.在Part的Property中,Value的值不能是中文;否则在导入到Allegro中时会提示出错:
5.Error with
……value;
6.在原理图中,走线一定要注意,避免出现误连,虚连的现象。
7.原理图中的Net name不能含空格,‘+’,‘-’。
手机用户96441
2011-03-29
知道答主
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方便点。
我一般都用PADS LOGIC画原理图,然后直接ECO到PADS LAYOUT中,也不用生成网表
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