三态门输出呈高阻态,若作为与门的其中一个输入端,此时输出如何判断? 10

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知无不道
2019-06-11 · TA获得超过5837个赞
知道大有可为答主
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三态门呈高阻时,与门输入端等同于悬空,如果是TTL与门那么这个输入端相当于输入1,如果是CMOS与门这种情况是不允许出现的,通常的做法是将与门输入端加上拉电阻。
AllBllearth
2019-10-21
知道答主
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既然这种情况不允许,那么画F2波形图的时候,是直接无输出么
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