FPGA的双口RAM,如果读比写快很多,那读的是什么,那读的那些地址都是空吗?
谢谢大家的回答,但还不是我想要的。比如一个RAM有512Byte,向里只写了一些不知道长度(比如20Bbyte)的数据,一个地址可以放1Bytes的数据,但读的速度很快,...
谢谢大家的回答,但还不是我想要的。
比如一个RAM有512Byte,向里只写了一些不知道长度(比如20Bbyte)的数据,一个地址可以放1Bytes的数据,但读的速度很快,读的地址很快就从0到511了,读的地址就清零重新开始了,怎么确定RAM的东西被读完了 展开
比如一个RAM有512Byte,向里只写了一些不知道长度(比如20Bbyte)的数据,一个地址可以放1Bytes的数据,但读的速度很快,读的地址很快就从0到511了,读的地址就清零重新开始了,怎么确定RAM的东西被读完了 展开
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写入的时候有地址啊。读的时候判断一下,是否大于写入的地址就可以了。当然如果是异步读写,注意一下时钟。
读比写得快,就是说读的那个地址还没有写入数据,那么应该是读出初始化时的数据,如果没有初始化那应该是不定态,同意楼上。同时,RAM模块里有clr引用,可以清空为0。
还有,FPGA上电复位时,基本上是0(和厂商有关,altera,xilinx 的FPGA都是0).
读比写得快,就是说读的那个地址还没有写入数据,那么应该是读出初始化时的数据,如果没有初始化那应该是不定态,同意楼上。同时,RAM模块里有clr引用,可以清空为0。
还有,FPGA上电复位时,基本上是0(和厂商有关,altera,xilinx 的FPGA都是0).
追问
写的地址写完后会清零,另外读的时钟比写的快多了
追答
那就加个寄存器,在写完时,把写入的地址保存下来
晓网科技
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双口RAM不是FIFO,双口RAM的一个地址是可以多次重复读写的,因此不存在读写速率匹配的问题。
如果是FIFO,读速度高于写速度,那么随着时间的累积,最终FIFO会“空”,此时的读出数据为无效数据,具体是什么值,与具体的FIFO有关系。
如果是FIFO,读速度高于写速度,那么随着时间的累积,最终FIFO会“空”,此时的读出数据为无效数据,具体是什么值,与具体的FIFO有关系。
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读RAM是给定地址然后出数据吧,读比写得快的话那就是说读的那个地址还没有数据写入,那么应该是读出初始化时的数据,如果没有初始化那应该是不定态了吧
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