简易14位数字密码锁控制电路设计,其中的ic9a模块用VHDL硬件描述语言编写 5

一、设计要求:1、14位数字密码分成高7位(DH6….DH0)和低7位(DL6….DL0),用数字逻辑开关预置,输出信号out为1表示开锁,否则关闭。2、14位数字密码分... 一、设计要求:
1、14位数字密码分成高7位(DH6….DH0)和低7位(DL6….DL0),用数字
逻辑开关预置,输出信号out为1表示开锁,否则关闭。
2、 14位数字密码分时操作,先预置高7位,然后再置入低7位,(顶层
电路可参考图1) 。
3、要求电路工作可靠,保密性强,开锁出错立即报警,(用声光两种
形式同时报警) 。
4、利用MAXPLUS2软件进行设计、编译、并在FPGA芯片上实现。
5、设计14位密码自己设定。比如:“10010010011100”。本次采用:前两位+本人学号倒数3位数字( 3位十进制数用BCD码表示)作为设计密码。
前两位分配:一班是01,二班是10, 三班是11,四班是00

2、原理分析:
Clk:置高7位密码控制脉冲。CLR:清零ic9a和D触发器。 Clk2:开锁控制信号。
L12:保证开锁可靠,保证单次触发。 out2B:密码正确指示。

操作步骤:参考图1
① 先清零 →置入DH6-DH0高位密码→② 按下CLK →高7位被存在ic9a的锁存器中 → ③ 置低7位密码→out2=1,表示开锁密码正确 →out2b=1 →标志输入正确密码。④ 按下CLK2 →这时L11的Q端控制三态门开锁out=1 .如果密码不正确,控制L15 →
out1A、out1B为高电平报警。

3、设计内容

设计简易14位数字密码译码模块ic9a,框图见下图,模块IC9A设计采用VHDL实现。

设计一个报警信号电路(频率:512 hz)作为CP报警用,方法不限。时钟 由实验箱CP2
中的4096HZ提供。

在ic9a模块基础上设计14位数字密码锁的顶层电路。

提高部分:增加修改密码功能。 (选作)
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 我来答
郑州小二哥
2011-12-29 · 超过13用户采纳过TA的回答
知道答主
回答量:100
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ic9a程序:LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY IC9A IS
PORT(CLK:IN STD_LOGIC;
CLR:IN STD_LOGIC;
D :IN STD_LOGIC_VECTOR(6 DOWNTO 0);
OUT2:OUT STD_LOGIC);
END IC9A;
ARCHITECTURE ART OF IC9A IS
SIGNAL QH:STD_LOGIC_VECTOR(6 DOWNTO 0);
BEGIN
PROCESS(CLK,CLR)
BEGIN
IF(CLR='1')THEN
QH<="0000000";
ELSIF (CLK'EVENT AND CLK='1') THEN
QH(6 DOWNTO 0)<=D(6 DOWNTO 0);
END IF;
IF(QH&D="00010000100111")THEN
OUT2<='1';
ELSE
OUT2<='0';
END IF;
追问
四班27号啊呵呵……咱同班,我想想是谁哈哈
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匿名用户
2012-01-03
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YHDYHD陆云钟可以到中国logo设计网,在百度搜下,并且价格合理,设计水平高!您可以咨询咨询!YHDYHD
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匿名用户
2011-12-26
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你是哪班的,,???
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知识1文库
2011-12-26
知道答主
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你用来干嘛的。。。网上好多啊。。。只要改一下就行了。。。
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