在QUARTUS II9.0如何中使用用Verilog语言生成的元件?
在file里creatupdate——》creatsymbolfileforcurrentfile就会生成一个原理图,我要怎么样就就可调用这个原理图呢?...
在file里 creat update ——》creat symbol file for current file就会生成一个原理图,我要怎么样就就可调用这个原理图呢?
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