verilog语言中的begin :BLOCK_A是什么意思啊！看不明这个啊，求高手
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begin..........end 是一个顺序过程的边界标记，他们俩之间的语句为顺序执行语句，与C/C++语言类似。
BLOCK_A是一个顺序过程的标记；如果过程中没有局部说明部分，不要求这一标记。也就是说在本begin.............end的语句中，如果没有定义局部变量，则这个标记可以没有，但如果定义了局部变量，比如有一个for循环，循环次数的变量是仅仅在该过程内有效而且没有定义在这个过程之外，就必须要这个顺序过程的标记。
BLOCK_A是一个顺序过程的标记；如果过程中没有局部说明部分，不要求这一标记。也就是说在本begin.............end的语句中，如果没有定义局部变量，则这个标记可以没有，但如果定义了局部变量，比如有一个for循环，循环次数的变量是仅仅在该过程内有效而且没有定义在这个过程之外，就必须要这个顺序过程的标记。
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if(***)
begin :BLOCK_A
XXXX
XXXX
end
else
begin : BLOCK_B
XXXX
XXXX
end
意思是:
第一个begin/end内的模块命名为BLOCK_A
第二个begin/end内的模块命名为BLOCK_B
做区分用，
一般情况下，可以不对begin/end命名。
begin :BLOCK_A
XXXX
XXXX
end
else
begin : BLOCK_B
XXXX
XXXX
end
意思是:
第一个begin/end内的模块命名为BLOCK_A
第二个begin/end内的模块命名为BLOCK_B
做区分用，
一般情况下，可以不对begin/end命名。
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类似命名空间
在里面命名的变量只能里面使用
在里面命名的变量只能里面使用
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