J-K触发器和D触发器的逻辑功能和触发方式
J-K触发器和D触发器的逻辑功能和触发方式如下：
1、JK触发器：
逻辑功能：JK触发器允许J与K同时为1。当J与K同时变为1的同时，输出的值状态会反转。也就是说，原来是0的话，变成1；原来是1的话，变成0。
触发方式：该触发器无一次变化现象，输入信号可在CP 触发沿由1变0时刻前加入。该电路要求J、K信号先于CP 信号触发沿传输到G3、G4的输出端,为此它们的加入时间至少应比CP的触发沿提前一级与非门的延迟时间。
2、D触发器：
逻辑功能：D触发器在CP(时钟脉冲)的前沿（正跳变0→1）发生翻转，触发器的次态取决于CP的脉冲上升沿到来之前D端的状态，即次态=D。因此，它具有置0、置1两种功能。
触发方式：D触发器由4个与非门组成，其中G1和G2构成基本RS触发器。电平触发的主从触发器工作时，必须在正跳沿前加入输入信号。如果在CP高电平期间输入端出现干扰信号，那么就有可能使触发器的状态出错。而边沿触发器允许在CP触发沿来到前一瞬间加入输入信号。
扩展资料：
触发器是具有记忆功能的二进制存储器件，是各种时序逻辑电路的基本器件之一。其结构有同步、主从、维持阻塞等三种电路.触发器按功能可分为RS触发器，JK触发器，D触发器和T触发器等；按电路的触发方式可分为主—从触发器和边沿触发器两大类。
目前我国生产的TTL集成触发器主要有边沿D触发器，边沿JK触发器与主—从JK触发器等。利用这些触发器可以转换成其他功能的触发器，但转换成的触发器其触发方式并不改变。例如由边沿变换来的仍是边沿触发方式的触发器。
参考资料来源：百度百科-JK触发器
参考资料来源：百度百科-D触发器
J-K触发器的逻辑功能：
JK触发器再有时钟脉冲作用时（CP=1）
当J=0 K=0时状态保持不变
当J= 0 K=1时次态为0态
当J=1 K=0时次态为1态
当J=1 K=1时次态与现态相反
D触发器（由与非门构成）：当D=1时，Q=0；当D=0时，Q=1；
D触发器的逻辑功能：
当SD=1且RD=0时(SD的非为0，RD的非为1，即在两个控制端口分别从外部输入的电平值，原因是低电平有效),不论输入端D为何种状态，都会使Q=0，Q非=1，即触发器置0；当SD=0且RD=1(SD的非为1，RD的非为0）时，Q=1，Q非=0，触发器置1,SD和RD通常又称为直接置1和置0端。我们设它们均已加入了高电平，不影响电路的工作。
JK触发器再有时钟脉冲作用时（CP=1）
当J=0 K=0时状态保持不变
当J= 0 K=1时次态为0态
当J=1 K=0时次态为1态
当J=1 K=1时次态与现态相反
D触发器（由与非门构成）：当D=1时，Q=0；当D=0时，Q=1；
触发方式
JK 触发器是在时钟沿触发的，一般是上升沿 RS D 有高电平触发，也有地电平触发，也有时钟沿触发
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J - K 触发器和 D 触发器的逻辑功能和触发方式
J-K触发器的逻辑功能：
JK触发器再有时钟脉冲作用时（ CP=1 ）当J=0 K=0时状态保持不变当J= 0 K=1时次态为0态当J=1 K=0时次态为 1态当J=1 K=1时次态与现态相反 D触发器（由与非门构成）：当D=1时， Q=0；当D=0时， Q=1；

D触发器的逻辑功能：
当SD=1且RD=0时(SD的非为0， RD的非为 1 ，即在两个控制端口分别从外部输入的电平值，原因是低电平有效),不论输入端D为何种状态，都会使Q=0， Q非=1，即触发器置0；当SD=0且RD=1(SD的非为1， RD的非为0）时， Q=1， Q非=0，触发器置1,SD和RD通常又称为直接置1和置0端。我们设它们均已加入了高电平，不影响电路的工作
