有关Altium Designer 6.0的问题
曾见过一种工程文件,打开后首先看到的是一个原理框图,包含电源,mcu,显示,AD等几个绿色的模块,模块之间有线连接,任何一个模块双击都会打开一张原理图,而所有的原理图共同...
曾见过一种工程文件,打开后首先看到的是一个原理框图,包含电源,mcu,显示,AD等几个绿色的模块,模块之间有线连接,任何一个模块双击都会打开一张原理图,而所有的原理图共同完成一张PCB。
这种画法叫什么?是怎么实现的?最有个实例+教程 展开
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层次原理图
首先在一个工程里面将你说的子电路图画好,将这个原理图模块需要与外界连接的输入输出用PORT口设置好,注意port是INPUT还是OUTPUT。然后在工程里新建一张原理做总图,再择Design-Create sheet symbol form sheet or hdl 弹出的对话框里有你刚刚画好的那张图,点确认就行了,鼠标上就多出了你所说的原理框图,也就是层次图,放在总图里就代表这个模块是总图的一部分,就可以将它当做元器件一样连线,它的“管脚”就是之前放置的PORT
这里有个要注意的地方,用层次图的时候要注意整个工程的网络连接方式的设置,在project option里面的option选项卡下,Net Identifier Scope建议设置成Hierarchical模式,意思是这个工程里的网络之间需要你用模块上的PORT口连线的方式连接上,而不是只要网络名一致它就会自动连接。这样的话,假设你两个一模一样的模块AD1 AD2在总图上,子图里都有名为SIG2的NET,这时虽然他们同名,但是这两个NET是不会自动练在一起的,它会自动更名为两个独立网络,除非你用PORT将这两个网络引出去并且在总图里连接上。
当然了,图不复杂的时候设置成Automatic模式也行,如果有问题自己检查一下就好了。
首先在一个工程里面将你说的子电路图画好,将这个原理图模块需要与外界连接的输入输出用PORT口设置好,注意port是INPUT还是OUTPUT。然后在工程里新建一张原理做总图,再择Design-Create sheet symbol form sheet or hdl 弹出的对话框里有你刚刚画好的那张图,点确认就行了,鼠标上就多出了你所说的原理框图,也就是层次图,放在总图里就代表这个模块是总图的一部分,就可以将它当做元器件一样连线,它的“管脚”就是之前放置的PORT
这里有个要注意的地方,用层次图的时候要注意整个工程的网络连接方式的设置,在project option里面的option选项卡下,Net Identifier Scope建议设置成Hierarchical模式,意思是这个工程里的网络之间需要你用模块上的PORT口连线的方式连接上,而不是只要网络名一致它就会自动连接。这样的话,假设你两个一模一样的模块AD1 AD2在总图上,子图里都有名为SIG2的NET,这时虽然他们同名,但是这两个NET是不会自动练在一起的,它会自动更名为两个独立网络,除非你用PORT将这两个网络引出去并且在总图里连接上。
当然了,图不复杂的时候设置成Automatic模式也行,如果有问题自己检查一下就好了。
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