2013-05-09
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----------带异步清零的4位加法计数器-------------LIBRARY IEEE;--定义用到的包/库
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY jsq IS --定义实体,它说明输入/输出端口
PORT ( CLK : IN STD_LOGIC; --计数时钟
CLR : IN STD_LOGIC; --异步清零
Q : OUT STD_LOGIC_VECTOR(3 DOWNTO 0); --计数输出END jsq;ARCHITECTURE behav OF jsq IS--定义结构体,它说明具体的功能
BEGIN
---------------------------------------
PROCESS (CLK,CLR)--进程
VARIABLE q1:STD_LOGIC_VECTOR(3 DOWNTO 0);--申明变量
BEGIN
IF CLR='0' THEN--CLR='0'时异步清零
q1:="0000";
ELSIF CLK'EVENT AND CLK='1' THEN
q1:=q1+1; --时钟上升沿到时,q1加1;END IF;END IF;Q<=q1; --最后输出;END PROCESS;END behav;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;ENTITY jsq IS --定义实体,它说明输入/输出端口
PORT ( CLK : IN STD_LOGIC; --计数时钟
CLR : IN STD_LOGIC; --异步清零
Q : OUT STD_LOGIC_VECTOR(3 DOWNTO 0); --计数输出END jsq;ARCHITECTURE behav OF jsq IS--定义结构体,它说明具体的功能
BEGIN
---------------------------------------
PROCESS (CLK,CLR)--进程
VARIABLE q1:STD_LOGIC_VECTOR(3 DOWNTO 0);--申明变量
BEGIN
IF CLR='0' THEN--CLR='0'时异步清零
q1:="0000";
ELSIF CLK'EVENT AND CLK='1' THEN
q1:=q1+1; --时钟上升沿到时,q1加1;END IF;END IF;Q<=q1; --最后输出;END PROCESS;END behav;
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上海巴鲁图工程机械科技有限公司_
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