三输入与非门VHDL源程序。
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ENTITY nand3 IS
PORT (in1,in2,in3: IN bit; y: OUT bit);
END nand3;
ARCHITECTURE rtl OF nand3 IS
BEGIN
y <= NOT (in1 AND in2 AND in3);
END rtl;
PORT (in1,in2,in3: IN bit; y: OUT bit);
END nand3;
ARCHITECTURE rtl OF nand3 IS
BEGIN
y <= NOT (in1 AND in2 AND in3);
END rtl;
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