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触发器具有记忆功能,是构成时序逻辑的基本单元,D 是触发器(计数器、存储器)的数据输入信号;Q 是触发器的数据输出信号。采用 D型触发器,在时钟的上升沿数据被锁存:Qn+1 = D (CP↑)。
这是可屏蔽中断触发方式的电路结构,屏蔽触发器 MASK 被程序置位,则 Q‘ = 0 ,中断请求信号 D 。
不会被中断寄存器 INTR 锁存,CPU 就不会响应中断请求;MASK 复位,中断信号通道打开。
这是可屏蔽中断触发方式的电路结构,屏蔽触发器 MASK 被程序置位,则 Q‘ = 0 ,中断请求信号 D 。
不会被中断寄存器 INTR 锁存,CPU 就不会响应中断请求;MASK 复位,中断信号通道打开。
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