如何把Verilog II语言转换成电路图
我设计了一个频率计，请教大神们我如何在QuartusII中把Verilog语言转换成电路图？...
我设计了一个频率计，请教大神们我如何在Quartus II中把Verilog语言转换成电路图？
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这个我也没学好 不大记得 估计是file->creat update->creat symbol file for current file
然后会在project这个目录下产生你要的元件 错了 别笑哦
然后会在project这个目录下产生你要的元件 错了 别笑哦
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意法半导体(中国)投资有限公司
2023-06-12 广告
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tools里的netlist viewers 然后 RTL Viewer
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