Question

verilog中下面这种写法对吗？

reg[7:0] mem[0:255] ;
always@(posedge clk) begin
if(data==num) begin
men[num]<=men[num]+1;
end

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Answer 1

除了mem和men的不同从写法来说是正确的，但是memory一般是不可综合的。还有+1最好改写成+1’b1

追问

那实际情况中能用这种写法对输入数据进行计数吗？输入的数据范围是0到255，想用256个计数器来计数，但是直接写256个寄存器的话非常麻烦，如果能够写成上面这种写法的话会轻松很多，不知道这样行不行，我是想要能综合的，就是要能上板子跑的程序。上面程序中的num是0到255的任何一个数据，不是确定的值