请教Spartan 6用什么配置芯片比较好
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就是无法生成vhdl的工程，只有顶层是vhdl的。为什么仿真example-design时报错，没有对生成的工程做任何修改，报错user-design下面的这个arb-row-col.v文件的252行在alway和begin附近有语法错误，这是mig生成的文件怎么会有错误，有谁遇到过吗？？
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