用verilog DHL语言设计一个5阶的M序列信号发生器，生成多项式位：f（x）=X^5+X^2+1 5
用verilogDHL语言设计一个5阶的M序列信号发生器，生成多项式位：f（x）=X^5+X^2+1...
用verilog DHL语言设计一个5阶的M序列信号发生器，生成多项式位：f（x）=X^5+X^2+1
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assign outdata = M_buf[0];
always@(posedge clk)
begin
if(!rst)
begin
M_buf <= 5'b01011;
end
else
begin //早姿5级芹睁宴M序列编嫌银码
M_buf[4] <= M_buf[0]^M_buf[3];
M_buf[0] <= M_buf[1];
M_buf[1] <= M_buf[2];
M_buf[2] <= M_buf[3];
M_buf[3] <= M_buf[4];
end
end
always@(posedge clk)
begin
if(!rst)
begin
M_buf <= 5'b01011;
end
else
begin //早姿5级芹睁宴M序列编嫌银码
M_buf[4] <= M_buf[0]^M_buf[3];
M_buf[0] <= M_buf[1];
M_buf[1] <= M_buf[2];
M_buf[2] <= M_buf[3];
M_buf[3] <= M_buf[4];
end
end
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always@(posedge clk or negedge rstn) begin
if(!rstn)
out[4:0] <= init_value;
else
out[4:0] <= {out[3]^out[4],out[2],out[1]^out[5],out[0],out[5]};
end
if(!rstn)
out[4:0] <= init_value;
else
out[4:0] <= {out[3]^out[4],out[2],out[1]^out[5],out[0],out[5]};
end
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