如何解决fpga high fanout问题
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clk 和 reset一定是high fanout这个不用管的，综合工具会在需要buffer的地方自动buffer的。
通常一个信号被太多地方引用也会形成high fanout的signal.
但是通常RTL也是不需要处理的。FPGA的综合工具会自动duplicate你的drive.
比如一个寄存器接了10个fanout，然后综合工具发现可能会驱动不动。这样的话，综合工具会把这个寄存器duplicate成两个。
这样两个寄存器会有相同的clk/reset，相同的input。然后这两个寄存器各驱动5个fanout，就能驱动了。
这样的代价是同样的逻辑因为做的duplicate所以会多花FPGA的逻辑资源。
如果你禁止了工具自动的duplicate优化，你写RTL的时候就可以把一个register分成两个，每个register各驱动一部分的fanout，相当于做了手工的优化。但是其实原理是一样的
通常一个信号被太多地方引用也会形成high fanout的signal.
但是通常RTL也是不需要处理的。FPGA的综合工具会自动duplicate你的drive.
比如一个寄存器接了10个fanout，然后综合工具发现可能会驱动不动。这样的话，综合工具会把这个寄存器duplicate成两个。
这样两个寄存器会有相同的clk/reset，相同的input。然后这两个寄存器各驱动5个fanout，就能驱动了。
这样的代价是同样的逻辑因为做的duplicate所以会多花FPGA的逻辑资源。
如果你禁止了工具自动的duplicate优化，你写RTL的时候就可以把一个register分成两个，每个register各驱动一部分的fanout，相当于做了手工的优化。但是其实原理是一样的
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意法半导体(中国)投资有限公司
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