如何用vhdl语言设计5进制减法计数器,我没悬赏分了。。。
1个回答
2012-05-12
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很简单的,计数器进程部分程序给你,其他的分频的,显示的部分你能行的
signal cq: intger ranger 0 to 5
process(clk)
begin
if lck' event and clk='1' then
if cq=0 then cq<=5
else cq<=cq-1;
end if;
end if;
end process;
signal cq: intger ranger 0 to 5
process(clk)
begin
if lck' event and clk='1' then
if cq=0 then cq<=5
else cq<=cq-1;
end if;
end if;
end process;
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TableDI
2024-07-18 广告
2024-07-18 广告
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