您好，我是fpga的初学者，想请教一下 怎么设定一个verilog程序的运行时间呢？
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fpga和你之前学过的单片机之类的不一样的
labview里是有设定程序的运行时间这个说法
但是fpga没有，fpga的运行时间是根据你用的开发板的，现在比较常见的就是50MHZ的时钟，就是20ns一个clk。你可以通过分频来获得想要的时钟频率
当然你在仿真的时候可以直接改变某个输入的时钟频率，至于怎么改要看你用的是哪个软件了
labview里是有设定程序的运行时间这个说法
但是fpga没有，fpga的运行时间是根据你用的开发板的，现在比较常见的就是50MHZ的时钟，就是20ns一个clk。你可以通过分频来获得想要的时钟频率
当然你在仿真的时候可以直接改变某个输入的时钟频率，至于怎么改要看你用的是哪个软件了
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北京康思
2018-09-20 广告
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